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2.9. DMA 直接存儲(chǔ)器存取(DMA)用來(lái)提供在外設(shè)和存儲(chǔ)器之間或者存儲(chǔ)器和存儲(chǔ)器之間的高速。 DMA 控制器有 7 條 DMA 通道，每條通道負(fù)責(zé)管理來(lái)自 1 個(gè)或者多個(gè)外設(shè)對(duì)存儲(chǔ)器訪問(wèn)的請(qǐng)求。DMA 控制 器包括處理 DMA 請(qǐng)求的仲裁器，用于處理各個(gè) DMA 請(qǐng)求的優(yōu)先級(jí)。 DMA 支持循環(huán)的緩沖器管理，了當(dāng)控制器到達(dá)緩沖器末端時(shí)需要干預(yù)用戶代碼。 每個(gè)通道都直接連接專用的硬件 DMA 請(qǐng)求，且都同樣支持軟件觸發(fā)。這些功能通過(guò)軟件來(lái)配置。 DMA 可用于主要外設(shè)：TIMERs，SPI, I2C, USART，ADC，DAC，CAN，USB GPIO DIV 2.10. 中斷 PY32F072 通過(guò) Cortex-M0+處理器內(nèi)嵌的矢量中斷控制器(NVIC)和一個(gè)擴(kuò)展中斷/事件控制器(EXTI)來(lái)處理 異常。 2.10.1. 中斷控制器 NVIC NVIC 是 Cortex-M0+處理器內(nèi)部緊耦合 IP。NVIC 可以處理來(lái)自處理器外部的 NMI（不可屏蔽中斷）和可 屏蔽外部中斷，以及 Cortex-M0+內(nèi)部異常。NVIC 提供了靈活的優(yōu)先級(jí)管理。 處理器核心與 NVIC 的緊密耦合大大減少了中斷事件和相應(yīng)中斷服務(wù)例程(ISR)啟動(dòng)之間的延遲。ISR 向量 列在一個(gè)向量表中，存儲(chǔ)在 NVIC 的一個(gè)基地地址。要執(zhí)行的 ISR 的向量地址是由向量表基址和用作偏移量的 ISR 序號(hào)組成的。 如果高優(yōu)先級(jí)的中斷事件發(fā)生，而低優(yōu)先級(jí)的中斷事件剛好在等待響應(yīng)，稍后到達(dá)的高優(yōu)先級(jí)的中斷事件 將首先被響應(yīng)。另一種優(yōu)化稱為尾鏈（tail-chaining）。當(dāng)從一個(gè)高優(yōu)先級(jí)的 ISR 返回時(shí)，然后啟動(dòng)一個(gè)掛起的 低優(yōu)先級(jí)的 ISR，將跳過(guò)不必要的處理器上下文的壓棧和彈棧。這減少了延遲，提高了電源效率。 NVIC 特性： ? 低延時(shí)中斷處理 ? 4 級(jí)中斷優(yōu)先級(jí) ? 支持 1 個(gè) NMI 中斷 ? 支持 32 個(gè)可屏蔽外部中斷 ? 支持 10 個(gè) Cortex-M0+異常 ? 高優(yōu)先級(jí)中斷可打斷低優(yōu)先級(jí)中斷響應(yīng) ? 支持尾鏈(tail-chaining)優(yōu)化 ? 硬件中斷向量檢索